ipq806x: revert SDC clock changes for NBG6817 MMC
[openwrt/openwrt.git] / target / linux / ipq806x / patches-5.10 / 097-4-ipq806x-gcc-add-missing-clk-and-reset-for-crypto-eng.patch
index f8f4924dd16ea71cdc8ea5638f68fc663e046971..d1e047cabf02bb1de35c8c476bb7dc00121038de 100644 (file)
@@ -107,7 +107,7 @@ Signed-off-by: Ansuel Smith <ansuelsmth@gmail.com>
        {  64000000, P_PLL8,  3, 1,   2 },
        {  96000000, P_PLL8,  4, 0,   0 },
        { 192000000, P_PLL8,  2, 0,   0 },
-@@ -2647,7 +2703,9 @@ static const struct freq_tbl clk_tbl_nss
+@@ -2645,7 +2701,9 @@ static const struct freq_tbl clk_tbl_nss
        { 110000000, P_PLL18, 1, 1, 5 },
        { 275000000, P_PLL18, 2, 0, 0 },
        { 550000000, P_PLL18, 1, 0, 0 },
@@ -117,7 +117,7 @@ Signed-off-by: Ansuel Smith <ansuelsmth@gmail.com>
        { }
  };
  
-@@ -2759,6 +2817,186 @@ static struct clk_dyn_rcg ubi32_core2_sr
+@@ -2757,6 +2815,186 @@ static struct clk_dyn_rcg ubi32_core2_sr
        },
  };
  
@@ -304,7 +304,7 @@ Signed-off-by: Ansuel Smith <ansuelsmth@gmail.com>
  static struct clk_regmap *gcc_ipq806x_clks[] = {
        [PLL0] = &pll0.clkr,
        [PLL0_VOTE] = &pll0_vote,
-@@ -2766,6 +3004,7 @@ static struct clk_regmap *gcc_ipq806x_cl
+@@ -2764,6 +3002,7 @@ static struct clk_regmap *gcc_ipq806x_cl
        [PLL4_VOTE] = &pll4_vote,
        [PLL8] = &pll8.clkr,
        [PLL8_VOTE] = &pll8_vote,
@@ -312,7 +312,7 @@ Signed-off-by: Ansuel Smith <ansuelsmth@gmail.com>
        [PLL14] = &pll14.clkr,
        [PLL14_VOTE] = &pll14_vote,
        [PLL18] = &pll18.clkr,
-@@ -2880,6 +3119,12 @@ static struct clk_regmap *gcc_ipq806x_cl
+@@ -2878,6 +3117,12 @@ static struct clk_regmap *gcc_ipq806x_cl
        [PLL9] = &hfpll0.clkr,
        [PLL10] = &hfpll1.clkr,
        [PLL12] = &hfpll_l2.clkr,
@@ -325,7 +325,7 @@ Signed-off-by: Ansuel Smith <ansuelsmth@gmail.com>
  };
  
  static const struct qcom_reset_map gcc_ipq806x_resets[] = {
-@@ -3011,6 +3256,11 @@ static const struct qcom_reset_map gcc_i
+@@ -3009,6 +3254,11 @@ static const struct qcom_reset_map gcc_i
        [GMAC_CORE3_RESET] = { 0x3cfc, 0 },
        [GMAC_CORE4_RESET] = { 0x3d1c, 0 },
        [GMAC_AHB_RESET] = { 0x3e24, 0 },